Если у вас возникли сложности с курсовой, контрольной, дипломной, рефератом, отчетом по практике, научно-исследовательской и любой другой работой - мы готовы помочь.
Предоплата всего
Подписываем
ДОКЛАД
В связи с расширением цифровых сетей связи в России остро стоит проблема перевода этих сетей на отечественную элементную базу.
Большинство цифровых сетей строится по иерархическому принципу, но наиболее массовым изделиями, применяемыми в этих сетях, является абонентское коммутационное оборудование. Поэтому задача разработки коммутатора абонентских каналов в виде заказной БИС актуальна.
Проектируемая БИС, предназначена для коммутации 256 каналов, в стандарте ИКМ –30/32, входящих абонентов с таким же количеством исходящих. Микросхема принимает информацию по восьми параллельным групповым входам и выдает ее синхронно по восьми групповым выходам.
На основе требований к коммутатору строится структурная схема. Блок Выделения Циклового и Сверхциклового Синхронизма предназначен для выделения сигналов цикловой и сверхцикловой синхронизации. Блок Циклового Выравнивания и Коммутации предназначен для выравнивания по циклам входящих каналов и их коммутации. Так как на вход поступает восемь пространственно разделенных каналов, то для выполнения заданных функций необходима пространственно-временная коммутация. Пространственной коммутации можно избежать, объединив все восемь входящих каналов в один, уплотненный по времени, поток, при этом коммутация сводится лишь к перестановке во времени импульсных сигналов уплотненного временного потока, но тогда внутренняя частота коммутатора возрастет в восемь раз и составит 16,384 МГц. Снижение внутренней частоты можно достичь, передавая восемь бит каждого из информационных каналов не последовательно, а по параллельной шине. После проведенной коммутации требуется обратно преобразовать уплотненный канал. Для выполнения данной функции на выход ставится Блок Формирования Исходящих Групповых Каналов, который и преобразует уплотненный временной канал в восемь каналов ИКМ-30/32. Работой всех блоков управляет Внутреннее Управляющее Устройство.
На основании структурной схемы были разработаны функционально-логические схемы блоков.
Блок Выделения Циклового и Сверхциклового Синхронизма состоит из восьми приемников циклового и сверхциклового синхронизма (по одному на каждый канал). Приемник циклового и сверхциклового синхронизма представляет собой устройство, которое обеспечивает поиск и удержание циклового и сверхциклового синхронизма. Синхронизация коммутатора необходима для правильного распределения коммутируемого сигнала по каналам.
Функционально такой приемник состоит из:
На блок циклового выравнивания и коммутации поступают входящие групповые каналы, его функция заключается в выравнивании каналов в соответствии с сигналом синхронизации и коммутировании каналов в соответствии с адресом, поступающим с устройства управления.
Принцип циклового выравнивания заключается в записи в запоминающее устройство информации входящих групповых каналов синхронно с выделенными тактовыми импульсами и считывании их синхронно со станционными импульсами тактовой и цикловой синхронизации.
Для осуществления коммутации необходимо сформировать общий, уплотненный во времени канал, и переставить импульсы из одной временной позиции в другую. Технически такую перестановку легко выполнить в запоминающем устройстве, если записывать информацию общего канала последовательно, а считывать в соответствии с картой коммутации.
Объединение процессов циклового выравнивания и коммутации позволяет сократить необходимый объем запоминающего устройства и уменьшить время задержки прохождения информационных сигналов. Для обеспечения данных функций блок циклового выравнивания и коммутации должен содержать утроенное количество запоминающих устройств. В одно из них постоянно производится запись, из другого считывание, а третье предназначено для записи при переполнении первого. Следовательно, блок циклового выравнивания и коммутации можно представить в виде 24х самостоятельных коммутационных элементов (по три на каждый канал).
Для обеспечения требуемых функций запоминающее устройство коммутации должно записать информацию всех 32х каналов за один цикл, т.е. должно обладать емкостью 256 бит.
Функциональная схема включает в себя:
Организация запоминающего устройства коммутации зависит от режима работы:
Запоминающее устройство адреса предназначено для хранения адреса входящего канала, информация которого поступает на выход в момент поступления станционного тактового импульса, соответствующего номеру исходящего канала.
Адрес входящего канала, состоит из 5ти разрядов. Но для функционирования устройства управления необходимо иметь информацию о состоянии канала в любой момент времени, для этого разрядность запоминающего устройства адреса была увеличена на 1 бит, который отображает состояние канала («1» – канал занят; «0» – канал свободен). Этот разряд так же может управлять состоянием выходного каскада ОЗУ, при появлении в данном разряде «0» выходной каскад ОЗУ переходит в третье состояние. Запоминающее устройство адреса обладает емкостью: 192 бита и имеет словарную организацию, как при записи информации, так и при считывании.
Функциональная схема запоминающего устройства адреса состоит из:
Работает устройство следующим образом:
В режиме считывания информации адрес коммутируемого канала должен поступить раньше начала считывания информации из запоминающего устройства коммутации, для этого необходима схема совпадения, формирующая сигнал разрешения чтения на запоминающее устройство коммутации. Так как сигнал разрешения чтения для запоминающего устройства адреса является постоянным, а информация на выходе обновляется благодаря счетчику тактовых импульсов, постоянно меняющему адрес считывания; то при включении схемы совпадения тактового импульса и сигнала разрешения чтения, на выходе этой схемы будет формироваться сигнал, соответствующий моменту поступления адреса на запоминающее устройство коммутации.
Блок формирования исходящих групповых каналов, предназначен для формирования 8ми каналов стандарта ИКМ - 30/32 из поступающего на его вход уплотненного во времени и разнесенного в пространстве скоммутированного канала. Для обеспечения непрерывного формирования каналов блок нуждается в двух запоминающих устройствах, в каждый момент времени из одного идет считывание, а в другой идет запись. В момент записи по параллельной шине передается восемь разрядов одного из каналов, следовательно, ОЗУ должно содержать восемь элементов в столбце. В момент считывания формируются восемь исходящих групповых каналов, в каждый момент времени на выход поступают восемь бит, по одному на каждый канал; следовательно, ОЗУ должно содержать восемь столбцов. Таким образом, общая емкость ОЗУ составляет 64 бит.
Организация ОЗУ словарная, но при записи информации каждая ячейка памяти состоит из элементов памяти, входящих в соответствующий столбец матрицы, а при считывании - из элементов, входящих в соответствующую строку. Схема данного устройства состоит из:
Принцип работы этой схемы заключается в следующем, при записи со счетчика адреса трехразрядный код поступает на дешифратор столбцов, а дешифратор строк отключается и восемь разрядов одного информационного канала поступает на элементы памяти выбранного столбца. При считывании отключается дешифратор столбцов, а трехразрядный код счетчика адресов поступает на дешифратор строк и восемь одноименных разрядов разных информационных каналов выбранной строки матрицы поступают на соответствующие восемь выходов исходящих групповых каналов. В результате на выходе коммутационной БИС формируются групповые каналы в стандарте ИКМ -30/32.
Элементы БИС выполнены по стандартной КМДП технологии, с двух уровневой металлизацией (одна выполнена из алюминия, другая из поликремния), с минимальной толщиной рисунка 1,2 мкм.
В дипломе проработаны вопросы технико-экономического обоснования разработки и вопросы экологии и безопасности жизнедеятельности, а так же был проведен патентный поиск на предмет патентной «чистоты».